VeriSilicon (688521.SH) acaba de lanzar la serie de IP de procesamiento digital de señales (Digital Signal Processing, DSP) ZSP5000, basada en su arquitectura DSP de quinta generación probada en silicio. Esta línea de productos utiliza un diseño altamente escalable y eficiente desde el punto de vista energético, y se ha optimizado notablemente para cargas de trabajo de cálculo intensivo como la visión por computadora y la IA integrada. Combinada con su arquitectura configurable, esta serie de IP puede proporcionar excelentes soluciones con eficiencia energética y computacional para diversos dispositivos periféricos.
Las IP de la serie ZSP5000 incluyen ZSP5000, ZSP5000UL, ZSP5000L y ZSP5000H. Ofrecen un rendimiento de procesamiento vectorial escalable que oscila entre 32 y 256 operaciones de multiplicación-acumulación (MAC) de 8 bits por ciclo. Para obtener un rendimiento aún mayor, ZSP5400H multinúcleo de VeriSilicon puede combinar varios núcleos ZSP5000H en una arquitectura multiclúster y ampliar así aún más la capacidad de cálculo.
La serie ZSP5000 cuenta con un conjunto de instrucciones potente e intuitivo optimizado para facilitar la programación y el ajuste eficiente del rendimiento, mientras que sus instrucciones dedicadas aceleran las tareas comunes de procesamiento de imágenes y señales, como la aritmética vectorial escalar, las reducciones horizontales, las permutaciones, los desplazamientos, las búsquedas en tablas, la compresión y el promediado. Integra la interfaz de coprocesador ZTurbo, que permite a los clientes sumar fácilmente instrucciones personalizadas y aceleradores de hardware dentro del mismo proceso, y es compatible con la interfaz de programación de aplicaciones (Application Programming Interface, API) OpenCV, lo que garantiza una integración perfecta con los principales marcos de visión por computadora. Además, la serie ZSP5000 está equipada con un subsistema de memoria con todas las funciones, un motor DMA 3D multicanal y una configuración multinúcleo escalable, lo que permite un despliegue flexible para una gran diversidad de aplicaciones.
Las IP de la serie ZSP5000 son compatibles con la serie escalar ZSPNano de VeriSilicon, y gestionan de forma eficaz cargas de trabajo mixtas de MCU y DSP. VeriSilicon también ofrece herramientas completas de desarrollo ZView, incluido un entorno de desarrollo integrado (Integrated Development Environment, IDE) basado en Eclipse, un simulador de ciclo preciso, un compilador de optimización, un depurador y herramientas de perfilado, que agilizan el desarrollo de software y la integración de sistemas.
«Con la creciente adopción de OpenCV y el aumento de la demanda de cargas de trabajo de visión por computadora junto con las NPU en la computación de inteligencia de periferia, presentamos ZSP5000, nuestra serie IP de DSP de nueva generación. Compatibles con la API OpenCV estándar del sector, permiten una interfaz simplificada con las NPU a través de nuestra interfaz FLEXA e integran funciones de procesamiento de audio para aplicaciones multimodales», explicó Weijin Dai, director de estrategia, vicepresidente ejecutivo y director general de la división IP de VeriSilicon. «La eficiencia energética es clave en la periferia, y las IP de la serie ZSP5000 incorporan una arquitectura de acceso a memoria optimizada para minimizar el consumo de energía del procesador. También cuentan con ZTurbo, un mecanismo de extensión de instrucciones personalizado diseñado para aplicaciones específicas, que permite una mayor optimización de la potencia y el rendimiento mediante la perfecta integración de aceleradores de hardware. Nuestros principales clientes ya están aprovechando estas capacidades para lograr avances significativos en cuanto a potencia y rendimiento».
Acerca de VeriSilicon
VeriSilicon se ha comprometido a proporcionar a los clientes servicios de silicio personalizados basados en plataformas, abarcativos y todo en uno, y servicios de licencia de IP de semiconductores aprovechando su IP de semiconductores propia. Para más información, visite: www.verisilicon.com.
Vea la versión original en businesswire.com: https://www.businesswire.com/news/home/20250622098974/es/
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Su arquitectura es altamente escalable y está optimizada para cargas de trabajo de imagen y visión por computadora con un conjunto de instrucciones ampliable. – Business Wire
